D-PHY℠ v3.5 全新升級：嵌入式時脈拓展應用無限可能
以更高頻寬、更低干擾與更靈活設計，拓展相機、顯示與感測應用新可能！
在MIPI D-PHY℠的最新版本規範v3.5，引入了embedded-clock mode，同時保留了現有的電壓和通道數，這增強了D-PHY℠對不斷發展的高性能、成本優化的攝影機和顯示器的適用性。嵌入式時脈能夠減少線路數量，並支援高頻寬應用，同時降低電磁干擾(EMI)限制。D-PHY℠ v3.5中新增的embedded-clock mode採用128B/132B編碼，並提供時脈資料復原(CDR)功能，無需專用時脈通道即可支援雙線高速通訊，當然v3.5中仍保留了傳送時脈選項，因此設計人員可以在系統中選擇使用其中一種或兩種時脈模式，新版本保持了與先前版本規範的向下相容性。
v3.5核心特色
🔵嵌入式時脈模式：採用128B/132B編碼+CDR，支援雙線高速通訊
🔵效能提升：釋放原本用於時鐘傳輸的通道，提升傳輸資料量
🔵相容性：保留時脈選項，並向下相容先前版本
🔵更佳EMC表現：改善電磁相容性，滿足嚴苛的 EMI 要求
MIPI D-PHY 工作小組正在透過這些方式不斷改進規範，
以滿足日益增長的感測器對更高頻寬的需求，並盡可能減少系統設計中所需的線路數量。
工作小組正在尋求參與該規範下一個重要更新的開發，目前設想的版本是 v4.0。
目前的 D-PHY v3.5支援每通道高達9Gbps的高速通信，
v4.0計劃將embedded-clock mode的通信速度提升至16 Gbps。
此外，除了目前支援的直流耦合之外，還計劃添加交流耦合。
此外，正在建立v3.5的符合性測試套件 (CTS)，以提高採用 D-PHY 的產品的互通性。
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